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      HIT 電池的制造工藝

      HIT 電池的制造工藝

      發(fā)布人:Jay 發(fā)布時間:2019-06-12 瀏覽次數(shù):2257

      HIT電池的關鍵技術是a-Si:H薄膜的沉積,要求說沉積的本征a-Si:H薄膜的缺陷態(tài)密度低,摻雜a-Si:H的摻雜效率高且光吸收系數(shù)低,最重要的是最終形成的a-Si:H/Si界面的態(tài)密度要低。目前,普遍采用的等離子體增強化學氣相沉積法(PECVD)沉積本征及摻雜的a-Si:H膜,同時熱絲化學氣相沉積發(fā)(HWCVD)制備a-Si:H法也被認為很有前景。


      HIT 電池


      PECVD法制備a-Si:H薄膜 利用等離子里中豐富的活性粒子來進行低溫沉積一直是a-Si:H制備的重要方法。在真空狀態(tài)下給氣體施加電場,氣體在電場提供的能量下會有氣態(tài)轉(zhuǎn)變?yōu)榈入x子體狀態(tài)。其中含有大量的電子、離子、光子和各類自由基等活性粒子。等離子體是部份離子化的氣體,與普通氣體相比,主要性質(zhì)發(fā)生了本質(zhì)的變化,是一種新物質(zhì)聚集態(tài)。等離子體中放置其中的襯底可以保持在室溫,而電子在電廠的激發(fā)下會得到足夠多的能量(2-5eV),通過與分子的碰撞將其電離,激發(fā)。PECVD的缺點表現(xiàn)在兩個方面,一是它的不穩(wěn)定性,二是電子和離子的輻射會對所沉積的薄膜構(gòu)成化學結(jié)構(gòu)上的損傷。等離子體作為準中性氣體,它的狀態(tài)容易被外部條件的改變而發(fā)生變化。襯底表面的帶電狀態(tài),反應器壁的薄膜附著,電源的波動,氣體的流速都會改變活性粒子的種類和數(shù)量,并且等離子體的均勻性也難以控制,這樣都會改變襯底的狀態(tài)。等離子體中的離子轟擊和光子輻照,除了會影響沉積膜的質(zhì)量,還會影響下面的硅襯底。光譜相應的研究結(jié)果表明對于藍光區(qū),HIT電池的光譜相應提高,而在紅光區(qū),光譜相應變低。這說明對于本征層的鈍化效果提高了藍光光譜響應的結(jié)果,而對于硅片內(nèi)部的損傷,則對紅光部分,光譜相應降低,量子效率下降。對于這種情況,可以下調(diào)等離子體的功率,但是同時也會降低等離子體的穩(wěn)定性。 HWCVD制備a-Si:H薄膜 熱絲化學氣相沉積HWCVD是利用熱絲對氣體進行催化和分解的軟性過程,不會產(chǎn)生高能粒子轟擊,對襯底的損傷較小,可以容易的移入或者移出沉積室,能夠方便從實驗室轉(zhuǎn)換到生產(chǎn)線上。 在HIT電池中,非晶硅發(fā)射極和晶體硅之間夾著5納米后,缺陷密度低于非晶硅的本征非晶硅薄膜。HWCVD的缺點在于非晶硅的外延可以穿透5納米后的本征薄膜而與晶體硅直接接觸,這樣會導致高缺陷,這樣界面面積和缺陷態(tài)密度的增大會導致高的暗電流,繼而開路電壓也會減低。在制備中將溫度控制在200度以下能夠抑制非晶硅的外延。 HIT電池工藝的改良方向 提高界面鈍化效果 當非晶硅和晶體硅的界面陷阱密度由1011每平方厘米上升到10~12每平方厘米時,電池效率會降低20%。本征非晶硅的鈍化效果由于a-Si:H薄膜的存在而變差,這可能是襯底中的少子波函數(shù)穿過本征非晶硅而和a-Si:H薄膜中的缺陷態(tài)相互作用,這樣構(gòu)成了載流子的復合通道。可以使用多形硅來作為鈍化層,因為它具有更低的缺陷態(tài)密度和暗電流。 光陷結(jié)構(gòu)和表面清洗 將制絨后的織構(gòu)表面層使用硫酸和雙氧水進行氧化,然后使用使用濃度為1%的氫氟酸進行60到180秒的腐蝕,這樣可以去除缺陷層來使粗糙度降低,接近拋光硅的效果。 柵電極的優(yōu)化設計 如果可以去除柵線的延展部分,縱橫比提高1.0以后,效率可以在提高1.6%。這取決于對于銀漿的流變學研究和絲網(wǎng)印刷的改進。

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